EDA 技术与VHDL-(第4版) 内容简介

　　《eda技术与vhdl(第4版)》系统介绍了eda技术和vhdl硬件描述语言，将vhdl的基础知识、编程技巧和实用方法与实际工程开发技术在先进的eda设计平台——quartus ii上很好地结合起来，使读者能通过本书的学习迅速了解并掌握eda技术的基本理论和工程开发实用技术，并为后续的深入学习和发展打下坚实的理论与实践基础。 　　作者依据高校课堂教学和实验操作的规律与要求，并以提高学生的实际工程设计能力和自主创新能力为目的，对全书内容作了恰当的编排。全书共分为7个部分：eda技术概述、vhdl语法知识及其实用技术、quartus ii及lpm宏模块的详细使用方法、基于verilog的有限状态机设计技术、基于vhdl的16位实用cpu设计技术及创新实践项目、基于modelsim的test bench仿真技术、基于matlab和dsp builder平台的eda设计技术及大量实用系统设计示例。除个别章节外，各章都安排了相应的习题和大量针对性强的实验和设计项目。书中列举的vhdl示例都经编译通过或经硬件测试。 　　《eda技术与vhdl(第4版)》主要面向高等院校本、专科eda技术和vhdl语言基础课，推荐作为电子工程、通信、工业自动化、计算机应用技术、电子对抗、仪器仪表、数字信号或图像处理等专业和相关实验指导课的授课教材或主要参考书，同时也可作为电子设计竞赛、fpga开发应用的自学参考书。  

EDA 技术与VHDL-(第4版) 目录

第1章 eda技术概述
1.1 eda技术
1.2 eda技术应用对象
1.3 硬件描述语言vhdl
1.4 eda技术的优势
1.5 面向fpga的eda开发流程
1.5.1 设计输入
1.5.2 综合
1.5.3 适配(布线布局)
1.5.4 仿真
1.5.5 rtl描述
1.6 可编程逻辑器件
1.6.1 pld的分类
1.6.2 prom可编程原理
1.6.3 gal
1.7 cpld的结构与可编程原理
1.8 fpga的结构与工作原理
1.8.1 查找表逻辑结构
1.8.2 cyclone iii系列器件的结构原理
1.9 硬件测试技术
1.9.1 内部逻辑测试
1.9.2 jtag边界扫描测试
1.10 编程与配置
1.11 quartus ii
1.12 ip核
1.13 eda的发展趋势
习题
第2章 vhdl程序结构与数据对象
2.1 vhdl程序结构
2.2 vhdl程序基本构建
2.2.1 实体和端口模式
2.2.2 结构体
2.2.3 库和库的种类
2.2.4 库和程序包的调用方法
2.2.5 配置
2.3 vhdl文字规则
2.3.1 数字
2.3.2 字符串
2.3.3 关键词
2.3.4 标识符及其表述规则
2.3.5 文件取名和存盘
2.3.6 规范的程序书写格式
2.4 vhdl数据对象
2.4.1 常数
2.4.2 变量
2.4.3 信号
习题
第3章 vhdl数据类型与顺序语句
3.1 vhdl数据类型
3.1.1 bit和bit_vector类型
3.1.2 std_logic和std_logic_vector类型
3.1.3 整数类型integer
3.1.4 布尔数据类型boolean
3.1.5 signed和unsigned类型
3.1.6 其他预定义类型
3.1.7 数据类型转换函数
3.2 vhdl*常用的顺序语句
3.2.1 赋值语句
3.2.2 case语句
3.2.3 process语句
3.2.4 并置操作符&
3.2.5 if语句
3.3 if语句使用示例
3.3.1 d触发器的vhdl描述
3.3.2 含异步复位和时钟使能的d触发器的vhdl描述
3.3.3 基本锁存器的vhdl描述
3.3.4 含清0控制的锁存器的vhdl描述
3.3.5 vhdl实现时序电路的不同表述方式
3.3.6 4位二进制加法计数器设计
3.3.7 计数器更常用的vhdl表达方式
3.3.8 实用计数器的vhdl设计
3.3.9 含同步并行预置功能的8位移位寄存器设计
3.3.10 优先编码器设计
3.4 vhdl其他顺序语句
3.4.1 loop循环语句
3.4.2 next语句
3.4.3 exit语句
3.4.4 wait语句
3.4.5 generic参数定义语句
3.4.6 report语句
3.4.7 断言语句
3.4.8 端口数据含1个数统计电路模块设计
习题
第4章 时序仿真与硬件实现
4.1 vhdl程序输入与仿真测试
4.1.1 编辑和输入设计文件
4.1.2 创建工程
4.1.3 全程编译前约束项目设置
4.1.4 全程综合与编译
4.1.5 仿真测试
4.1.6 rtl图观察器应用
4.2 引脚锁定与硬件测试
4.2.1 引脚锁定
4.2.2 编译文件下载
4.2.3 jtag间接编程模式
4.2.4 usb-blaster驱动程序安装方法
4.3 电路原理图设计流程
4.3.1 用原理图输入方式设计半加器
4.3.2 完成全加器顶层设计
4.3.3 对全加器进行时序仿真和硬件测试
4.4 利用属性表述实现引脚锁定
4.5 宏模块逻辑功能查询
4.6 signaltap ii的使用方法
4.7 编辑signaltap ii的触发信号
习题
实验与设计
实验4-1 多路选择器设计实验
实验4-2 十六进制7段数码显示译码器设计
实验4-3 计数器设计实验
实验4-4 硬件消抖动电路设计
实验4-5 应用宏模块设计数字频率计
实验4-6 数码扫描显示电路设计
实验4-7 串行静态显示控制电路设计
实验4-8 不同类型的移位寄存器设计实验
第5章 vhdl并行语句
5.1 并行信号赋值语句
5.1.1 简单信号赋值语句
5.1.2 条件信号赋值语句
5.1.3 选择信号赋值语句
5.1.4 块语句
5.1.5 元件例化语句
5.1.6 全加器设计与例化语句应用

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