高性能集成电路设计 本书特色

本书旨在整合目前纳米级集成电路主要关注的以互连为中心的设计方法。全书分为五个部分，从互连网络、电源管理、时钟同步、噪声隔离等几个方面来介绍以互连为中心的集成电路设计。**部分主要介绍集成电路的发展史以及从晶体管和互连的角度来看工艺缩放技术；第二部分主要介绍互连网络，包括互连的一般特性、大型网络中的互连传输特性、串扰以及全局信号传输方法；第三部分主要介绍跟互连相关的电源管理，具体为电源的产生、分布、计算机辅助设计、降低供电噪声的方法以及功耗；第四部分主要介绍同步系统，包含同步过程、片上时钟的生成、同步系统、片上时钟分布等；第五部分主要探讨大规模混合信号系统，分析了集成电路中的衬底耦合噪声并介绍了降低该类噪声的方法。

高性能集成电路设计 目录

第ⅰ部分  背 景 知 识
第1章  引言
1.1  历史简介
1.1.1  晶体管
1.1.2  集成电路
1.2  多样的摩尔和超越摩尔
1.3  ic设计目标回顾
1.4  本书架构

第2章  缩放技术
2.1  器件缩放
2.1.1  mos器件原理
2.1.2  恒定电场缩放
2.1.3  恒定电压缩放
2.1.4  器件的缩放方案比较
2.2  小尺寸效应
2.2.1  阈值电压滚降
2.2.2  漏感应势垒降低
2.2.3  速度饱和
2.2.4  迁移率退化
2.3  器件优化
2.3.1  非均匀沟道掺杂
2.3.2  应变工程
2.3.3  高k和金属栅结构的组合
2.3.4  多栅器件
2.4  互连的缩放
2.4.1  全局与局部互连
2.4.2  理想缩放
2.4.3  更加实际的缩放方案
2.4.4  不同互连线缩放方案的比较
2.5  互连的改进
2.5.1  超低k介质材料
2.5.2  三维集成
2.5.3  片上光互连
2.5.4  碳基片上互连
2.6  本章小结

第ⅱ部分  互 连 网 络

第3章  互连模型及其提取
3.1  互连设计标准
3.1.1  延迟
3.1.2  带宽
3.1.3  噪声
3.1.4  功耗
3.1.5  物理面积
3.2  互连电容
3.2.1  互连电容的组成
3.2.2  互连线的电容提取
3.3  互连电阻
3.3.1  铜电阻率
3.3.2  互连电阻的提取
3.4  互连电感
3.4.1  电感的定义
3.4.2  电感的频率的相关
3.4.3  片上电感何时重要
3.4.4  互连电感提取过程
3.5  本章总结

第4章  信号传输分析
4.1  集总模型和分布式模型
4.1.1  集总模型
4.1.2  分布式传输线模型
4.1.3  分布式互连线的集总表示
4.1.4  确定*高频率
4.1.5  封闭解
4.2  模型降阶
4.2.1  rc连线的elmore延迟
4.2.2  wyatt近似
4.2.3  延迟界限： penfieldrubinstein算法
4.2.4  矩匹配
4.2.5  渐进波形估计
4.2.6  计算rlc树的矩
4.2.7  awe方法的优点与局限性
4.2.8  传递函数的直接截断法（dtt）
4.2.9  rlc线的elmore延迟
4.2.10  krylov空间技术
4.3  本章总结

第5章  互连耦合噪声
5.1  主动和被动的器件噪声
5.1.1  热噪声
5.1.2  散粒噪声
5.1.3  闪烁噪声
5.2  容性耦合噪声
5.2.1  耦合电容的缩放特点
5.2.2  耦合电容与翻转率的关系
5.2.3  容性耦合噪声的建模
5.3  感性耦合噪声
5.4  总线结构的互连线
5.5  耦合噪声的影响
5.5.1  功能失效
5.5.2  毛刺功耗
5.5.3  延迟不确定性的增加
5.6  本章总结

第6章  全局信号
6.1  互连技术优化
6.1.1  构建互连树结构
6.1.2  线宽、 线间距及线形
6.2  电路级信号
6.2.1  容性负载： 锥形中继器设计
6.2.2  锥形指数因子
6.2.3  锥形指数因子的改进
6.2.4  电阻负载： rc线中中继器的插入
6.2.5  *优的中继器数量和大小
6.2.6  感性负载： rlc互连线中的中继器插入
6.2.7  树形互连结构中的中继器插入
6.2.8  插入中继器以降低耦合噪声
6.2.9  屏蔽线插入
6.2.10  调整门的尺寸
6.2.11  信号重布线及线重新排序
6.3  全局信号的权衡
6.4  本章总结

第ⅲ部分  电 源 管 理

第7章  电源的产生
7.1  稳压器
7.1.1  稳压效率
7.1.2  能量效率
7.2  线性稳压器
7.2.1  基本特征
7.2.2  低压差稳压器
7.2.3  低压差稳压器设计中的权衡

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